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申威421M
• 基于第三代“申威64”核心(增强版)研制的4核心通用处理器,采用28nm代工工艺,工作频率设计目标为2GHz;
• 4个核心以CC_NUMA方式共享片上三级共享Cache,并且三级Cache容量达到8MB;
• 计算性能:主频2GHz时的双精度浮点性能可高达128GFlops;
• 访存性能:集成单路64位DDR3存储控制器,传输率最高达2133MBps,支持ECC校验;最大可支持内存容量高达32GB;
• I/O性能:集成单路PCI-E3.0×8接口,双向聚合有效带宽提高到16GBps。
产品手册
       申威421M处理器是基于第三代“申威64”核心(增强版)的国产高性能多核处理器,主要面向中低端桌面计算机应用。
       申威421M采用对称多核结构和SoC技术,单芯片集成了4个64位RISC结构的申威处理器核心,目标设计主频为2GHz。芯片还集成单路DDR3存储控制器和单路PCI-E3.0标准I/O接口。



参数 性能指标
核心数量   4
核心频率   设计目标频率2.0GHz。
峰值运算速度   浮点:每秒1280亿次双精度浮点结果@2.0GHz;
  整数:每秒720亿次整数结果2.0GHz。
工艺特征   内核电源:0.95V±5%;
  I/O电源:1.5V±10%,1.8V±10%。
Cache容量   每个核心包含两级Cache,Cache行长度为128字节;
  一级Cache:指令与数据分离,容量分别为32KB,均采用4路组相联结构;
  二级Cache:指令与数据混合,容量为512KB,采用8路组相联结构;
  4个核心共享三级Cache,容量为8MB,Cache行长度为128字节,采用32路组相联结构。
存储空间   支持64位虚地址空间,实际实现43位虚地址;
  支持40位物理地址。
存储器接口   单路64位DDR3存储器接口,支持纠单错、检双错的ECC校验,最大传输率为2133MBps;
  支持的总存储器容量最大可达32GB;
  支持连接DDR3 SDRAM芯片、UDIMM或RDIMM存储器条。
I/O接口   单路PCI-E 3.0 ×8接口,单链路有效带宽8GBps;
  维护接口支持兼容Jtag标准的芯片调试与维护。
封装特性   采用FC-BGA封装,引脚数为532。
功耗   热设计功耗:20W(4核心);
  典型运行功耗:待实际测量。